高位宽直采,一步到位:芯动神州ADCP2162-310双通道16位310MSPS ADC正式发布

发布时间:2026-09-09 10:52
作者:AMEYA360
来源:芯动神州
阅读量:150

  在高速模数转换器领域,芯动神州此前已推出覆盖125MSPS至GSPS级的多款ADC产品,广泛应用于通信接收、测试测量和工业采集等场景。今天,这一产品序列迎来新的成员。芯动神州正式发布ADCP2162-310——双通道、16位、310MSPS高速模数转换器,面向通信中频直采、多模数字接收机、测试与仪器仪表、智能天线系统等对动态性能和采样带宽同时提出高要求的应用。该器件与AD9652引脚兼容,现有硬件设计可原位替换验证。

高位宽直采,一步到位:芯动神州ADCP2162-310双通道16位310MSPS ADC正式发布

  一、为什么需要一颗面向第二奈奎斯特区的16位ADC?

  通信接收机和宽带仪器的中频数字化,长期面临一个两难:中频频率越高,前端混变频次越少、链路越简洁,但ADC在高输入频率下的动态性能往往迅速劣化。许多器件在30MHz低中频下指标亮眼,一旦输入信号推进到170MHz第二奈奎斯特区,SNR和SFDR便跌出可用区间,工程师只能退回"先混频、再采样"的传统链路,重新承担混频器带来的噪声、杂散和相位误差。ADCP2162-310的设计目标,就是让16位精度在465MHz满功率带宽内始终可用:170MHz中频可以直接采样,链路少一级混频,系统少一处误差来源。

  二、ADCP2162-310核心参数一览

高位宽直采,一步到位:芯动神州ADCP2162-310双通道16位310MSPS ADC正式发布

  这些参数并非孤立罗列——310MSPS采样率、465MHz带宽、16位分辨率与高频段动态指标的组合,恰好踩中了中频直采接收机和宽带采集设备的核心约束。下面逐条解读。

  三、四大核心优势深度解读

  1、170MHz第二奈奎斯特区直采,动态性能全程在线

  ADCP2162-310的交流规格给出了30MHz至400MHz全频段数据:70MHz输入时SNR75.0dBFS、SFDR87dBc;推进到170MHz第二奈奎斯特区,SNR仍保持73.7dBFS,SFDR保持85dBc;即使305MHz输入,SNR仍有70.7dBFS。专有差分输入设计配合片内3.3V缓冲器,在简化外部驱动电路的同时维持了高频段的信噪比表现——中频从70MHz搬到170MHz,链路预算无需推倒重来。

  2、大信号场景下,弱信号依然可见

  接收机最苛刻的考验是阻塞场景。ADCP2162-310在70.1MHz与72.1MHz双音输入(各−7dBFS)下双音SFDR达93dBc,184.12MHz与187.12MHz双音下仍有83dBc;噪声谱密度−156.7dBFS/Hz(小信号下−157.6dBFS/Hz),强邻道干扰存在时弱目标信号不会被杂散和底噪淹没。片内扰动(dither)功能可进一步改善小信号线性度;快速阈值检测(FDA/FDB)引脚在输入超限时直接输出硬件告警,外部AGC环路无需等待FPGA解算幅度即可快速响应,防止前端过载。

  3、时钟灵活+SYNC同步,为多通道阵列而生

  器件差分时钟输入最高接受1.24GHz,内部1、2、4、8整数分频产生采样时钟,内置占空比稳定器补偿占空比偏差,外部时钟源选型不再受苛刻占空比指标约束;同时,1.24GHz低相噪时钟源经片内分频后驱动采样内核,也有助于压低孔径抖动对高频段SNR的侵蚀。SYNC输入支持多芯片确定性同步,配合90dB通道隔离度,两颗芯片即可构成四通道相位一致的接收阵列。所有配置经三线式SPI完成,寄存器支持回读,便于产线自动化校准。可编程输入量程(2Vp-p至2.5Vp-p)则让前端驱动匹配保留调整余地。

高位宽直采,一步到位:芯动神州ADCP2162-310双通道16位310MSPS ADC正式发布

  4、引脚兼容,迁移零硬件改动

  ADCP2162-310与ADIAD9652引脚兼容,现有基于该平台的原理图和PCB无需改动即可原位替换,SPI寄存器配置流程保持一致,FPGA侧LVDS接收逻辑直接复用。对新项目而言,这意味着成熟参考设计和驱动代码可以直接继承,验证周期大幅缩短。

  四、典型应用场景

  ADCP2162-310的应用边界由"16位精度+310MSPS+465MHz带宽"定义——所有需要在中频频段直接采样、且对动态范围敏感的接收与采集场景,都是它的主场:

  雷达与通信接收机——高频段SNR/SFDR保障复杂电磁环境下的目标分辨能力。

  多模数字接收机(3G/4G)——170MHz中频直采,16位精度支撑多载波数字化解调,双通道覆盖I/Q或分集接收。

  测试与仪器仪表——310MSPS采样率与−156.7dBFS/Hz噪声谱密度,适配宽带采集卡与频谱分析前端。

  智能天线系统——SYNC多芯片同步加双通道高隔离度,为相位敏感的多通道阵列提供可扩展采样前端。

  五、供应链保障与本土技术支持

  高速ADC的采购周期直接影响整机研发节奏。ADCP2162-310在国内量产,供货稳定、交期可控;芯动神州本土FAE团队提供从原理图评审、LVDS时序对齐、SPI配置调试到量产导入的全流程支持,验证问题可获得快速响应——国产替代的最后一公里,靠的是响应速度,而不只是参数对齐。

  六、总结与量产信息

  从125MSPS到310MSPS,芯动神州在高速ADC领域的产品布局进一步完善:ADCP2162-310以双通道16位、465MHz满功率带宽和第二奈奎斯特区不打折的动态性能,补上了中频直采接收链路的关键一环。少一级混频,就少一处噪声源和相位误差来源——接收机架构的简化,从这颗ADC开始。

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2026-08-26 09:26 阅读量:260
万跳快扫覆盖6.0GHz:芯动神州TRX9361快速跳频测量方案
  6.0 GHz频段,106个56MHz频点,每点驻留100μs——10.6ms完成一次全频段扫描,每秒近100次。这不是宽频带射频采样卡的数据,而是一颗10mm × 10mm封装的RF捷变收发器:芯动神州TRX9361。  一、为什么要用快速跳频做宽带频谱测量  频谱监测、信道占用率统计、干扰源定位——这些应用有一个共同特征:覆盖尽可能宽的射频频段,获取信号的有无与强度信息。传统方案通常有两条路径。第一条是宽频带射频数字化采样。使用GHz级采样率ADC或RFSoC直接捕获全频段IQ数据。这种方式信息最完整,但数据量惊人。以2 GHz采样率、12位精度、I/Q双通道为例,每秒原始数据约6 GB。长时间监测对存储容量、传输带宽和后端算力都提出极高要求。第二条是窄带接收机调谐扫描。通过开关切换前端滤波器组,逐段覆盖频段。受限于开关切换时间和滤波器组数量,扫描周期通常在毫秒至百毫秒量级,难以捕获瞬态信号。两条路径的矛盾在于:要么数据量爆炸,要么扫描太慢。但如果重新审视监测目标——很多时候,工程师并不需要完整的IQ波形。频谱占用率统计只需要某个频点有没有信号;干扰排查只需要知道异常信号的频率和强度;信道状态监测只需要判断频段是否被占用。这些场景的共同点是:只关心信号有无和强度,不关心调制内容。这个诉求打开了一条新路径:用窄带RF收发器快速跳频,逐点扫描,每次跳频只读取RSSI值。数据量极小,扫描速度极快。  二、TRX9361的频率合成器与快速跳频能力  TRX9361集成用于产生收发本振的两个小数N分频PLL频率合成器(RX和TX各一个),另有基带PLL产生采样时钟,三者均内置VCO和环路滤波器,不需要任何外部元件。以下参数直接支撑快速跳频应用:  频率合成器采用小数N分频架构,LO频率可以以2.4 Hz的步长任意设置。这意味着跳频步进不受固定信道栅格约束,可以按需设置:宽扫用56 MHz步进快速覆盖全频段,精扫用更细步进对可疑频段做密集采样。两者可在同一套硬件上通过软件切换,无需更换前端。  三、快速跳频的工程实现  本文关于快速跳频机制的描述依据AD9361原厂公开资料,TRX9361相关内容来自项目实测记录;文中项目实测值均标注其适用条件,不应视为全配置通用结论。本文内容不直接适用于其他型号器件。  常规频率切换的瓶颈  常规模式下,改变LO频率需要通过SPI写入频率控制字并触发VCO校准。当频率变化超过100MHz时,VCO需要重新搜索和校准,PLL锁定时间显著增加。以40MHz参考时钟、TDD模式为例,VCO校准约需43μs,PLL锁定约需20μs。如果频率变化超过100MHz,还需触发额外校准流程,总时间可达数百微秒。对于每秒上万次跳频的场景,常规模式的校准开销不可接受。  Fast Lock机制  该架构提供FastLock模式。其核心思路是:在系统初始化阶段,预先对所有目标跳频频率完成VCO校准,将校准结果(VCO调谐电压、电荷泵电流等参数)存入芯片内部Profile寄存器。芯片最多可存储8组FastLockProfile。跳频时,通过SPI或CTRL_IN硬件引脚直接调用已保存的Profile,跳过VCO搜索过程,PLL锁定时间缩减至约15–25μs。其中CTRL_IN引脚控制方式延迟最低、时序最确定,适合高密度跳频场景。TRX9361数据手册确认器件提供"四个实时I/O控制引脚",可用于此目的。当跳频点超过8个时,可将多余Profile存放在基带处理器中运行时动态加载,但会增加SPI写入开销,需要在跳频密度和Profile管理之间做工程权衡。  跳频时序设计  以监测8个56MHz宽信道为例,设计每次跳频驻留100μs:  PLL锁定(FastLock模式):约20μs  AGC稳定与RSSI采样:约60μs  SPI读取RSSI+Profile切换准备:约20μs  单次跳频周期:100μs  8信道全扫描:800μs  每秒扫描次数:约1250次  每秒RSSI数据量:约10000个读数,每个2字节,总计约20kB/s  对比全带宽IQ采集:以该架构最大采样率61.44MSPS、16位I/Q双通道存储计算,每秒原始数据约246MB。跳频扫描的数据量降低了四个数量级。一台普通嵌入式处理器即可实时处理全部扫描数据,无需高端PC或大容量存储。  全频段扫描的Profile管理  当目标是从70MHz到6.0GHz做全频段扫描(约106个56MHz频点),8组片上Profile不足以覆盖所有频点。工程上可采用分段策略:  将106个频点分为若干组,每组8个频点对应一组Profile  扫描完当前组后,通过SPI从基带处理器加载下一组Profile  Profile加载期间暂停跳频,加载完成后继续扫描  每次加载8个Profile的SPI写入时间约需数十微秒,对整体扫描周期的影响可忽略。全频段扫描约需10–11ms(含Profile加载开销),每秒可完成近100次完整频段扫描。  四、应用场景  频谱占用率统计:在70MHz–6.0GHz范围内按56MHz步进扫描,106个频点,每点100μs,全频段扫描约10.6ms,每秒近100次完整扫描。适合长期频谱占用率监测、无线电管理巡检、频谱资源规划数据采集。  信道状态监测:对特定通信频段做密集扫描。例如在1.7–2.2GHz的3GPP频段内以较细步进扫描,快速发现空闲信道,支撑动态频谱接入(DSA)和认知无线电应用。  瞬态干扰捕获:FastLock模式下约20μs的PLL锁定时间,配合RSSI快速采样,可捕获毫秒级瞬态干扰信号。对干扰源定位、频谱合规测试有直接价值。  多节点协同监测:TRX9361支持多器件同步功能。多颗芯片共享同一参考时钟,多芯片同步功能可实现多节点时间对齐,支撑TDOA到达时差定位等高级监测手段。  五、自主可控  TRX9361在国内量产,封装与引脚定义与AD9361一致。现有基于AD9361的FPGA驱动代码、SPI配置序列、FastLockProfile管理逻辑可直接复用,迁移验证成本低。芯动神州本土FAE团队可提供接口调试到量产导入的全流程技术支持。  六、结语  当射频工程师手里只有一颗56MHz带宽的收发器,面对6.0GHz的频谱空间,不必在宽频带采样卡和慢速机械调谐之间二选一。TRX9361以2.4Hz的LO步长、FastLock机制的微秒级锁定和片上RSSI,给出了第三条路:用速度换带宽,用窄带逐点扫描替代全频段采集。这对频谱监测、信道占用率统计、瞬态干扰捕获这些"只关心信号有无"的场景,是一套值得纳入设计选型的工程方案。
2026-08-24 10:50 阅读量:292
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