晶体的负载电容如何选择？匹配不当会有什么影响？

发布时间：2026-11-10 13:17
作者：AMEYA360
来源：网络
阅读量：202

　　晶体常用于单片机、实时时钟和通信电路，为系统提供频率基准。常见的皮尔斯振荡电路会在无源晶体两端各接一只对地电容。这两只电容会影响振荡频率与启动可靠性，不能仅凭经验统一选用某个数值。

　　晶体规格书中的负载电容CL，是晶体达到标称频率时所需的外部等效电容，并不等于某一只外接电容，也不是晶体自身的静态并联电容C0。选型时，应先确认晶体的标称频率、负载电容、等效串联电阻及允许驱动功率，再核对芯片振荡器的适配范围。

　　对于常见的双电容电路，可按简化模型估算：

　　CL≈C1×C2/(C1+C2)+Cs。

　　其中，C1、C2为两侧对地电容，Cs为按模型折算的寄生电容，涉及芯片引脚、焊盘和走线等因素。若两只电容相等，则C1=C2≈2×(CL-Cs)。因此，不能把规格书中的CL直接当作每只外接电容的容量。

　　例如，晶体要求CL为12.5pF，估算Cs为2.5pF，则两只外接电容可先各选20pF。这里的寄生电容只是设计假设，实际数值会随芯片和布板变化。如果芯片内置可调负载电容，还须依据手册重新核算，避免与外接电容重复叠加。

　　电容宜选择温度稳定性较好的C0G或NP0陶瓷器件，并根据频率误差预算确定容量容差。晶体和电容应靠近振荡引脚，走线尽量短，远离高速信号及开关电源节点，接地方式遵循芯片厂商建议。照抄其他电路的容量，未必能得到相同效果。

　　匹配不当首先表现为频率偏移。在常见的并联谐振工作方式下，实际负载电容偏大，振荡频率通常降低;偏小，频率通常升高。实时时钟可能因此走快或走慢，通信电路也可能因时钟误差超标而出现异常。若误差为20ppm，一天累计的计时偏差约为1.73秒。

　　负载电容过大，还可能降低起振裕量、延长启动时间，严重时无法起振。某些电路室温下能够工作，低温、低电压或批量生产后却暴露问题。因此，不能只靠继续增大电容来追求“更稳定”，也不能为容易起振而随意减小电容。

　　此外，负载匹配不能消除晶体自身的初始误差、温度漂移和老化影响。调试时应区分误差来源，避免通过更换电容掩盖其他问题，也不宜仅凭一块样板的结果确定批量参数。

　　计算值只是起点，最终还应在实板上验证频率、启动时间和驱动功率，并覆盖工作温度、电源变化及器件偏差。测量宜优先使用芯片缓冲后的时钟输出;直接探测晶体引脚时，应使用低电容探头，避免探头本身改变负载，造成频率偏移甚至停振。

晶体的负载电容如何选择？匹配不当会有什么影响？


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